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Xilinx 扩展 SmartConnect 技术为 16nm UltraScale+ 器件实现 20%-30% 性能
作者:ICGOGO | 发布时间:2016-05-23
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2016 年 4 月 21 日，中国北京 - All Programmable 技术和器件的全球领先企业赛灵思公司（Xilinx, Inc. (NASDAQ:XLNX)）今天宣布推出Vivado® Design Suite 2016.1 的 HLx 版本。该全新套件新增了 SmartConnect 技术支持，能为 UltraScale™ 和 UltraScale+ 产品组合带来前所未有的高性能。Vivado Design Suite 2016.1 版本包含 SmartConnect 技术扩展，可解决高性能数百万系统逻辑单元设计中的系统互联瓶颈，从而让 UltraScale 和 UltraScale+ 器件组合在实现高利用率的同时,还能将性能进一步提升 20%-30%。

赛灵思 UltraScale+ 产品组合是业界唯一一款基于 FinFET 的可编程技术。其包括Zynq®、Kintex® 和 Virtex® UltraScale+ 器件，相对于 28nm 产品而言,性能功耗比提升 2-5 倍，能支持 5G 无线、软件定义网络和下一代高级驾驶员辅助系统等市场领先应用。

赛灵思 SmartConnect 技术包括系统互联 IP 以及 UltraScale+ 芯片技术创新所带来的最新优化：

AXI SmartConnect IP：赛灵思的新型系统连接生成器将外设与用户设计整合在一起。SmartConnec t创建的定制互联功能能最好地满足用户的系统性能要求，从而能以更少的占用面积和功耗实现更高的系统吞吐量。现在,用户可通过 Vivado Design Suite 2016.1版本中的 Vivado IP Integrator 抢先体验。
借用时间和有用的歪斜优化：这些优化技术得到新型 UltraScale+ 精细时钟延迟插入功能的支持。这些全自动化功能通过将时序裕量从设计的高速路径转移到关键路径上，能够缓解大的线路延迟，并让设计运行在更高时钟频率上。
流水线分析与重定时：这些方法通过在设计中增加额外的流水线级，并运用自动寄存器重定时优化技术，让设计人员能够进一步提高性能。

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